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Ausar / SimpleCPU

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Ausar 提交于 2019-11-15 14:49 . 更改了一下说明

SimpleCPU

BY:Ausar

介绍

复读一下P6

乘法、除法器均为verilog手写。除法器有效率以及时序上的优化,但是乘法器是朴素实现。

DUCK-TEST分支是一个顺序双发射的分支 但是这个分支存在着严重的bug 已修复bug的版本不在这个项目内部 顺序双发射属于实验性质的工程,可以作为了解,但是不要直接拿去用

Verilog
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